FPGAへの実装
ファイルが完成したら、FPGAへの実装を行います。
実装時の制約条件については、実装ボードである NEXYS Video に合わせて以下のように設定します。
"kite_top.xdc" の内容。
## Clock Signal
set_property -dict { PACKAGE_PIN R4 IOSTANDARD LVCMOS33 } [get_ports { clk }];
create_clock -add -name sys_clk_pin -period 10.00 -waveform {0 5} [get_ports clk]
## Buttons
set_property -dict { PACKAGE_PIN G4 IOSTANDARD LVCMOS15 } [get_ports { cpu_resetn }];
## HDMI out
set_property -dict { PACKAGE_PIN U1 IOSTANDARD TMDS_33 } [get_ports { hdmi_tx_clk_n }];
set_property -dict { PACKAGE_PIN T1 IOSTANDARD TMDS_33 } [get_ports { hdmi_tx_clk_p }];
set_property -dict { PACKAGE_PIN Y1 IOSTANDARD TMDS_33 } [get_ports { hdmi_tx_n[0] }];
set_property -dict { PACKAGE_PIN W1 IOSTANDARD TMDS_33 } [get_ports { hdmi_tx_p[0] }];
set_property -dict { PACKAGE_PIN AB1 IOSTANDARD TMDS_33 } [get_ports { hdmi_tx_n[1] }];
set_property -dict { PACKAGE_PIN AA1 IOSTANDARD TMDS_33 } [get_ports { hdmi_tx_p[1] }];
set_property -dict { PACKAGE_PIN AB2 IOSTANDARD TMDS_33 } [get_ports { hdmi_tx_n[2] }];
set_property -dict { PACKAGE_PIN AB3 IOSTANDARD TMDS_33 } [get_ports { hdmi_tx_p[2] }];
## Configuration options, can be used for all designs
set_property CONFIG_VOLTAGE 3.3 [current_design]
set_property CFGBVS VCCO [current_design]
制約条件ファイルを設定した後,論理合成・配置・配線・ビットストリーム生成までを行う.
実装作業は以下のように行う.
- これまで作成したファイル(*.v, *.mif, *.xdc)をすべて src ディレクトリに置く.
- rgb2dviに関するファイルは,srcと同じディレクトリ階層にrgb2dviのディレクトリを作り,その中にrgb2dvi関連のファイルを置いておく.
- FPGAの実装処理用に,srcとrgb2dviのディレクトリと同じ階層にimpディレクトリを作成しその中に入る.
- impディレクトリ内に, kite_top.tcl をダウンロードする.このファイルはVivodoを用いてFPGA実装を行うためのコマンドファイルである.
準備ができたら,impディレクトリ内で,以下のコマンドによりFPGAへの実装を行う.
vivado -mode tcl -source kite_top.tcl
問題がなければ,FPGAの構成データ(ビットストリーム)が
"./project_1/project_1.runs/impl_1/kite_top.bit"
として生成されているはずです.生成できたら,NEXYS Video 上のFPGAへダウンロードし実機での動作を確認します.
※ 動作確認については担当教員へ問い合わせのこと.
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